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崗位職責(zé)

1,、負(fù)責(zé)數(shù)字電路結(jié)構(gòu)設(shè)計,、代碼設(shè)計、驗證要求及其他設(shè)計文檔撰寫。
2,、獨(dú)自進(jìn)行產(chǎn)品模塊的代碼設(shè)計,、驗證,、綜合,、優(yōu)化以及時序分析工作。
3,、配合 FPGA 工程師驗證 Debug,。

任職要求

1、熟悉數(shù)字前端 IC 設(shè)計流程,。
2,、熟練使用相關(guān) EDA 設(shè)計和仿真工具，對邏輯綜合,、時序收斂,、形式驗證等數(shù)字前端設(shè)計方法有一定了解。
3,、熟悉 Verilog 代碼編寫及其驗證,，有 1~2 個相關(guān) ASIC 項目流片經(jīng)驗優(yōu)先,。
4、電子,、微電子及相關(guān)專業(yè)本科及其以上學(xué)歷，3 年以上工作經(jīng)驗,。

招聘單位：江蘇多維科技有限公司成都分公司

工作地址：成都武侯區(qū)成都市武侯區(qū)科華北路力寶大廈北樓1218室

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